Neue Anwendungsbereiche erfordern immer mehr Anpassungsfähigkeit und Leistung. Um mit den sich ändernden Benutzeranforderungen, den Verbesserungen der Systemfunktionen, den sich ändernden Protokoll- und Datenkodierungsstandards und den Anforderungen an die Unterstützung einer Vielzahl unterschiedlicher Benutzeranwendungen fertig zu werden, verlangen viele neue Anwendungen in den Bereichen Kommunikation, Computer und Unterhaltungselektronik, dass ihre Funktionalität auch nach der Herstellung des Systems flexibel bleibt. Rekonfigurierbare Systems-on-a-Chips (SoCs), die verschiedene Mikroprozessorkerne und verschiedene Arten von rekonfigurierbaren Fabrics einsetzen, sind eine attraktive Lösung für diese Bereiche. Die zunehmende Bedeutung rekonfigurierbarer Bausteine in solchen Systemen erfordert ein HW/SW-Co-Design für SoCs, um den Zielkonflikt zwischen Softwareausführung und rekonfigurierbarer Hardwarebeschleunigung zu lösen. Die dynamischen Rekonfigurationsmöglichkeiten aktueller rekonfigurierbarer Geräte schaffen eine zusätzliche Dimension im zeitlichen Bereich. In der Phase der Design Space Exploration müssen die mit der Rekonfiguration und den Hardware/Software-Schnittstellen verbundenen Overheads sorgfältig evaluiert werden, um das volle Potenzial der dynamischen Rekonfiguration auszuschöpfen. Der Kurs führt die Teilnehmer in das Konzept der Rekonfigurierbarkeit in FPGAs ein und stellt die verfügbaren Mechanismen und Technologien auf der Bausteinebene sowie die Tools und Designmethoden vor, die für das Design rekonfigurierbarer FPGA-basierter Systeme erforderlich sind. Der Kurs stellt die verschiedenen Aspekte des Entwurfs FPGA-basierter rekonfigurierbarer Systeme vor, wobei der Schwerpunkt auf dynamisch selbst rekonfigurierbaren Systemen liegt. Die für den Entwurf eines dynamisch rekonfigurierbaren Systems erforderlichen Entwurfsmethoden und Werkzeuge werden vorgestellt und beschrieben, ebenso wie die Probleme, die dabei zu berücksichtigen sind.

FPGA-Rechensysteme: Partielle dynamische Rekonfiguration
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FPGA-Rechensysteme: Partielle dynamische Rekonfiguration

Dozent: Marco Domenico Santambrogio
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Empfohlene Erfahrung
Was Sie lernen werden
Sie werden lernen, die 5 Ws in Bezug auf einen rekonfigurierbaren Hardwarekontext zu benennen
Sie werden lernen, welche Techniken verwendet werden können, um mit dem Overhead umzugehen, der durch die partielle dynamische Rekonfiguration entsteht
Sie werden verschiedene Abläufe vergleichen, um ein rekonfigurierbares System zu realisieren, und Sie werden die Phasen erklären, aus denen sich ein Designablauf für ein FPGA-basiertes System zusammensetzt.
Sie werden die Gründe für den Wechsel zu rekonfigurierbaren Cloud-Lösungen und den Wechsel von einem einzelnen FPGA-basierten System zu einem verteilten Szenario verstehen
Kompetenzen, die Sie erwerben
- Kategorie: Cloud Infrastructure
- Kategorie: Systems Design
- Kategorie: System Design and Implementation
- Kategorie: Embedded Systems
- Kategorie: Hardware Architecture
- Kategorie: Cloud Computing
- Kategorie: Computer Architecture
- Kategorie: Software Design
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In diesem Kurs gibt es 4 Module
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